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> 高玉玲
一种基于CPLD的简易定时器的设计
作者:
高玉玲
来源:
中国现代教育装备
日期: 2024-10-29
人气:5
文章介绍一种以ACPLD为主控芯片的简易定时器,可以实现00:00-23:59之间任意时间的定时。该定时器的设计以AVHDL为开发工具,以MAX+PLUSII为软件平台,采用模块化设计。文中给出了部分模块的VHDL源程序及仿真图。
关键词:
VHDL语言
CPLD
定时器
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